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  FPGA培訓課程表

        培訓結束后頒發工程師培訓證書。

   班級規模及環境--熱線:4008699035 手機:15921673576( 微信同號)

        為了保證培訓效果,增加互動環節,我們堅持小班授課,每期報名人數限3到5人。人手一機,全程實踐。

   上課時間和地點

          上課地點:【上海】:同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】:北京中山學院/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領館區1號(中和大道) 【沈陽分部】:沈陽理工大學/六宅臻品 【鄭州分部】:鄭州大學/錦華大廈 【石家莊分部】:河北科技大學/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協同大廈
        

    本課程每期班限額5名,報滿即停止報名,請提前在線或電話預約

   課時

        ◆課時:咨詢在線客服
        ◆團體報名優惠措施:兩人95折優惠,三人或三人以上9折優惠 。注意:在讀學生憑學生證,即使一個人也優惠500元。
        ◆外地學員:代理安排食宿(需提前預定)
        ☆注重質量
        ☆邊講邊練

        ☆合格學員免費推薦工作

        ☆合格學員免費頒發相關工程師等資格證書,提升您的職業資質

        專注高端培訓15年,曙海提供的證書得到本行業的廣泛認可,學員的能力
        得到大家的認同,受到用人單位的廣泛贊譽。

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   質量保障

        1、培訓過程中,如有部分內容理解不透或消化不好,可免費在下期培訓班中重聽;
        2、培訓結束后,培訓老師留給學員手機和Email,免費提供半年的技術支持,充分保證培訓后出效果;
        3、培訓合格學員可享受免費推薦就業機會。 ☆合格學員免費頒發相關工程師等資格證書,提升您的職業資質。專注高端培訓15年,曙海提供的證書得到本行業的廣泛認可,學員的能力得到大家的認同,受到用人單位的廣泛贊譽。

   課程大綱
        全部授課內容均在計算機和實驗器材上實際操作。 周末班、連續班、晚班任選

培訓課程表

 

序號

最近開課時

FPGA培訓課程表

X1

面向軟件設計人員的基于 C 語言的 HLS 編碼培訓
C-based HLS Coding for Software Designers

面向軟件設計人員的基于 C 語言的 HLS 編碼培訓
(C-based HLS Coding for Software Designers)

2019年12月16日

5天;
30學時

X2

Xilinx FPGA 的基本 DSP 實現技巧培訓

Xilinx FPGA 的基本 DSP 實現技巧培訓

2019年12月16日

5天;
30學時

X3

利用系統生成器(System Generator)實現的DSP設計培訓

2019年12月16日

5天;
30學時

X4

設計Xilinx數字信號處理系統培訓

2019年12月16日

5天;
30學時

X5

FPGA測試培訓

2019年12月16日

5天;
30學時

X6

基于xilinx fpga的高速數據連接技術培訓

2019年12月16日

5天;
30學時

X7
使用 Xilinx 模擬混合信號方案進行設計培訓 2019年12月16日 5天;
30學時
X8
FPGA Power Optimization功能優化培訓 2019年12月16日 5天;
30學時
X9
Xilinx 部分重配置工具和技術培訓 2019年12月16日 5天;
30學時
X10
ISE 設計工具流程培訓 2019年12月16日 5天;
30學時
X11
降低成本的 FPGA 設計技術培訓 2019年12月16日 5天;
30學時
X12
利用 ChipScope Pro 工具實現的調試技術培訓 2019年12月16日 5天;
30學時
X13
利用 PlanAhead 分析與設計工具進行基本設計培訓
2019年12月16日 5天;
30學時
X14
利用 PlanAhead 設計分析工具進行高級設計培訓
利用 PlanAhead 設計分析工具進行高級設計培訓
2019年12月16日 5天;
30學時
X15
FPGA性能設計培訓 2019年12月16日 5天;
30學時

X16

Vivado Design Suite 的高級工具和技術培訓

Vivado Design Suite 的高級工具和技術培訓

2019年12月16日

5天;
30學時

X17

Vivado Design Suite 靜態時序分析和 Xilinx 設計約束培訓

Vivado Design Suite 靜態時序分析和 Xilinx 設計約束培訓

2019年12月16日

5天;
30學時

X18

Vivado Design Suite 靜態時序分析和 Xilinx 設計約束培訓

2019年12月16日

5天;
30學時

X19

面向 ISE 軟件用戶的 Vivado Design Suite 高級 XDC 和靜態時序分析培訓

2019年12月16日

5天;
30學時

X20

面向 ISE 軟件項目瀏覽器用戶的 Vivado Design Suite培訓

面向 ISE 軟件項目瀏覽器用戶的 Vivado Design Suite培訓

2019年12月16日

5天;
30學時

X21

Vivado Design Suite Tool Flow(Vivado Design Suite 工具流程)培訓

2019年12月16日

5天;
30學時

X22
如何設計高速存儲器接口培訓 2019年12月16日 5天;
30學時
X23
Xilinx FPGA 的信號完整性和開發板設計培訓 2019年12月16日 5天;
30學時
X24
利用千兆位級串行 I/O 進行設計培訓 2019年12月16日 5天;
30學時
X25
設計 Xilinx 連接功能系統培訓 2019年12月16日 5天;
30學時
X26
FPGA設計方法培訓FPGA Design Methodology 2019年12月16日 5天;
30學時
X27
使用5系列FPGA進行設計培訓之
利用 Virtex-5 FPGA 系列進行設計培訓
2019年12月16日 5天;
30學時
X28
使用6系列FPGA產品進行設計培訓之利用 Spartan-6 和 Virtex-6 系列進行設計培訓
2019年12月16日 5天;
30學時
X29
Altera FPGA設計技術培訓
2019年12月16日 5天;
30學時

 
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.(2014年7月11).................................................................................................................................
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